序号 |
课 程 名 称 |
培 训 目 标 |
最近开课时间 |
学 期 |
FPGA培训课程表 |
X1 |
面向软件设计人员的基于 C 语言的 HLS 编码培训
(C-based HLS Coding for Software Designers) |
面向软件设计人员的基于 C 语言的 HLS 编码培训
(C-based HLS Coding for Software Designers) |
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客服 |
X2 |
Xilinx FPGA 的基本 DSP 实现技巧培训 |
Xilinx FPGA 的基本 DSP 实现技巧培训 |
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客服 |
X3 |
|
利用系统生成器(System Generator)实现的DSP设计培训 |
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客服 |
X4 |
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设计Xilinx数字信号处理系统培训 |
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客服 |
X5 |
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FPGA测试培训 |
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客服 |
X6 |
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基于xilinx fpga的高速数据连接技术培训 |
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客服 |
X7 |
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使用 Xilinx 模拟混合信号方案进行设计培训 |
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5天;
30学时 |
X8 |
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FPGA Power Optimization功能优化培训 |
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5天;
30学时 |
X9 |
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Xilinx 部分重配置工具和技术培训 |
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5天;
30学时 |
X10 |
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ISE 设计工具流程培训 |
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5天;
30学时 |
X11 |
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降低成本的 FPGA 设计技术培训 |
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5天;
30学时 |
X12 |
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利用 ChipScope Pro 工具实现的调试技术培训 |
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5天;
30学时 |
X13 |
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利用 PlanAhead 分析与设计工具进行基本设计培训
|
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5天;
30学时 |
X14 |
利用 PlanAhead 设计分析工具进行高级设计培训
|
利用 PlanAhead 设计分析工具进行高级设计培训
|
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5天;
30学时 |
X15 |
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FPGA性能设计培训 |
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5天;
30学时 |
X16 |
Vivado Design Suite 的高级工具和技术培训 |
Vivado Design Suite 的高级工具和技术培训 |
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客服 |
X17 |
Vivado Design Suite 静态时序分析和 Xilinx 设计约束培训 |
Vivado Design Suite 静态时序分析和 Xilinx 设计约束培训 |
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客服 |
X18 |
|
Vivado Design Suite 静态时序分析和 Xilinx 设计约束培训 |
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客服 |
X19 |
|
面向 ISE 软件用户的 Vivado Design Suite 高级 XDC 和静态时序分析培训 |
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客服 |
X20 |
面向 ISE 软件项目浏览器用户的 Vivado Design Suite培训 |
面向 ISE 软件项目浏览器用户的 Vivado Design Suite培训 |
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客服 |
X21 |
|
Vivado Design Suite Tool Flow(Vivado Design Suite 工具流程)培训 |
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客服 |
X22 |
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如何设计高速存储器接口培训 |
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5天;
30学时 |
X23 |
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Xilinx FPGA 的信号完整性和开发板设计培训 |
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5天;
30学时 |
X24 |
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利用千兆位级串行 I/O 进行设计培训 |
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5天;
30学时 |
X25 |
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设计 Xilinx 连接功能系统培训 |
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5天;
30学时 |
X26 |
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FPGA设计方法培训FPGA Design Methodology |
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5天;
30学时 |
X27 |
|
使用5系列FPGA进行设计培训之
利用 Virtex-5 FPGA 系列进行设计培训 |
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5天;
30学时 |
X28 |
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使用6系列FPGA产品进行设计培训之利用 Spartan-6 和 Virtex-6 系列进行设计培训
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5天;
30学时 |
X29 |
|
Altera FPGA设计技术培训
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5天;
30学时 |